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- 标题：基于FPGA的8位数码管动态显示电路设计
- 作者：张彩荣
- 学校：江苏师范大学
- 组别：理工
- 评论：666 条
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[361楼] 江苏师范大学-邢志强 - 评论于：2015-06-05 19:05:55
作者-张彩荣回复：邢志强的原贴：
张老师上课通俗易懂 我对quartusⅱ的使用更进一步了
你的实验课还是比较认真的! -
[362楼] 徐州工程学院-张娅 - 评论于：2015-06-05 18:33:00
作者-张彩荣回复：张娅的原贴：
慕名而来，从容不迫的娓娓道来，这个教学气质和功力真是让我们好佩服。自己要加油啦。
谢谢你的观看!相互学习! -
[363楼] 江苏师范大学-丁依依 - 评论于：2015-06-05 17:14:14
作者-张彩荣回复：丁依依的原贴：
老师，怎样才能让数码管的扫描慢一点
就是输入的扫描频率低一些,或者输入了固定的频率,但分频高一些也行 -
[364楼] 江苏师范大学-赵芮 - 评论于：2015-06-05 17:12:53
作者-张彩荣回复：赵芮的原贴：
老师讲的很好，容易接受。
多多练习! -
[365楼] 江苏师范大学-仲梦婕 - 评论于：2015-06-05 17:08:25
作者-张彩荣回复：仲梦婕的原贴：
老师讲课讲的很清楚。容易懂。关于这个问题我想问一下如何让数码管的动态扫描慢一点？
加到位选的扫描频率低一些 -
[366楼] 江苏师范大学-丁依依 - 评论于：2015-06-05 16:54:05
作者-张彩荣回复：丁依依的原贴：
老师讲的很好，有助于我对数码管动态显示原理进一步的理解和掌握
有帮助最好了 -
[367楼] 江苏师范大学-周潮 - 评论于：2015-06-05 16:30:34
作者-张彩荣回复：周潮的原贴：
很好
没问题吗? -
[368楼] 江苏师范大学-池帅 - 评论于：2015-06-05 15:57:54
作者-张彩荣回复：池帅的原贴：
参数定义的二进制计数器，书上例题5.4中有一段“always @(posedge clk or negedge reset） if（!reset）out=0; else if（en） out=out+1；”能看出是8位二进制计数器，怎么看是不受时钟控制的异步清零的呢？
敏感条件是(posedge clk or negedge reset） ,这样没有posedge clk时,若有negedge reset,则满足if（!reset）,输出out=0;这就说明了清零是不受时钟控制的,就是异步清零 -
[369楼] 江苏师范大学-卢静馨 - 评论于：2015-06-05 15:35:01
作者-张彩荣回复：卢静馨的原贴：
if(a===1'bx) $display("aisk") 可以明白是成当a等于x时，这个语句执行，但是if(a==1'bx) $display("aisk") 为什么语句翻译成当a等于x时，这个语句不执行呢？
相等==比较时,无法比较不定状态x,所以if(a==1'bx)的返回值永远不会是1,后面的语句永远不会执行. -
[370楼] 江苏师范大学-后多梅 - 评论于：2015-06-05 14:34:14
作者-张彩荣回复：后多梅的原贴：
张老师，我想请问您，==和===有什么区别？还有什么情况下用&什么情况下用&&，怎么样区别缩位运算和逻辑运算？
==是相等比较,主要比较0和1,===是全等比较,x和z也参与比较.按位做逻辑运算时用&,整体做逻辑运算时用&&，缩位运算是单目操作运算,只有一个操作数,逻辑运算要有两个操作数. -
[371楼] 江苏师范大学-徐超 - 评论于：2015-06-05 14:24:39
作者-张彩荣回复：徐超的原贴：
老师讲的很好，让我弄懂了fpga的8位数码管动态显示电路的设计。
换成其它位数的也能设计吗? -
[372楼] 江苏师范大学科文学院-易明峰 - 评论于：2015-06-05 14:21:34
作者-张彩荣回复：易明峰的原贴：
张老师的讲解非常清楚，重点也明确，使我受益匪浅，很好。
但愿对你有帮助! -
[373楼] 江苏师范大学-张恩梓 - 评论于：2015-06-05 13:02:43
作者-张彩荣回复：张恩梓的原贴：
张老师我们电气工程的学生学数字系统设计和plc，这两门技术的发展前景怎么样啊？那一门比较好啊？
plc在工业中应用广泛,它是独立的控制器了 -
[374楼] 江苏师范大学-张建新 - 评论于：2015-06-05 12:51:01
作者-张彩荣回复：张建新的原贴：
张老师的课条理挺清晰，内容也较全面，听过后能顺利的设计出这个电路，对其原理也掌握了。
自己再改改功能,重新设计,可以吗? -
[375楼] 江苏师范大学-张高强 - 评论于：2015-06-05 12:48:16
匿名回复：
作者-张彩荣回复：张高强的原贴：
verilog hdl语言中的大写字母与小写字母没有区别吗？
有的,大小写是敏感的.
那为什么按实验书上面的那个数码管扫描显示原理图，在编译的时候，出现编译错误显示引脚d重复，而把程序中的d换掉后，编译就正确了？ -
[376楼] 江苏师范大学-卢健康 - 评论于：2015-06-05 12:46:55
作者-张彩荣回复：卢健康的原贴：
张老师你好，通过你的这个视频讲解，我更深一步的了解用fpga显示8位动态数码显示管，但是我想问的是当程序还有实验箱连线正确时，为什么数码管不能正确显示数字？
是不是你将138译码器的高低位接反了?或者你设计的计数器方向反了? -
[377楼] 江苏师范大学-苏海雷 - 评论于：2015-06-05 12:42:53
作者-张彩荣回复：苏海雷的原贴：
通过张老师的讲解对quartus的使用有了新的理解，收获颇多
一定多练习哟! -
[378楼] 江苏师范大学-黄琛 - 评论于：2015-06-05 12:39:30
作者-张彩荣回复：黄琛的原贴：
张老师讲课由浅入深，让我这样的初学者也获益颇多。
多设计一些电路会更熟练的. -
[379楼] 连云港中等专业学校-孙艳 - 评论于：2015-06-05 12:32:33
作者-张彩荣回复：孙艳的原贴：
张老师的微课内容选材合理，内容贴近生活.授课时教态自然,重难点突出，思路清晰，由浅入深，环环相扣。并且充分利用了信息化教学手段，使原本枯燥的专业课显得生动活泼！整堂课听下来有耳目一新的感觉！受益非浅！值得学习！
谢谢孙老师观看,有机会还要向你学习! -
[380楼] 中国矿业大学-王亢亢 - 评论于：2015-06-05 12:32:14
作者-张彩荣回复：王亢亢的原贴：
讲课思路清晰，条理明确
谢谢亢亢!祝一切顺利!
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